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Architectures for soft-decision decoding of non-binary codes

García Herrero, Francisco Miguel (Universitat Politècnica de València, 2013-11-19)

En esta tesis se estudia el dise¿no de decodificadores no-binarios para la correcci'on de errores en sistemas de comunicaci'on modernos de alta velocidad. El objetivo es proponer soluciones de baja complejidad para los ...
Diseño de decodificadores de altas prestaciones para código LDPC

Angarita Preciado, Fabián Enrique (Universitat Politècnica de València, 2013-09-02)

En esta tesis se han investigado los algoritmos de decodificación para códigos de comprobación de paridad de baja densidad (LDPC) y las arquitecturas para la implementación hardware de éstos. El trabajo realizado se centra ...
Diseño e implementación en FPGA de decodificadores de códigos Reed-Solomon para operar a Gbps

Perrone, Gabriele (Universitat Politècnica de València, 2016-11-25)

[EN] Reed-Solomon error correcting codes are being included in the last 100 Gbps Ethernet standards. The aim of this work is the design and implementation of hardware architectures suitable for decoding Reed-Solomon codes ...
VLSI algorithms and architectures for non-binary-LDPC decoding

Lacruz Jucht, Jesús Omar (Universitat Politècnica de València, 2016-11-04)

[EN] This thesis studies the design of low-complexity soft-decision Non-Binary Low-Density Parity-Check (NB-LDPC) decoding algorithms and their corresponding hardware architectures suitable for decoding high-rate codes at ...

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