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RiuNet: Repositorio Institucional de la Universidad Politécnica de Valencia
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| Verification of the clock and reset subsystem of an integrated circuit using standardised UVM verification methodologies | 87 |
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|---|---|---|---|---|---|---|---|
| Verification of the clock and reset subsystem of an integrated circuit using standardised UVM verification methodologies | 1 | 2 | 4 | 2 | 3 | 4 | 0 |
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Países con más visualizaciones
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| Estados Unidos | 25 |
| Rumania | 23 |
| China | 7 |
| España | 6 |
| Irlanda | 6 |
| EU | 3 |
| Austria | 2 |
| Finlandia | 2 |
| Francia | 2 |
| Corea del Sur | 2 |
Ciudades con más visualizaciones
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|---|---|
| Resita | 11 |
| Bucharest | 10 |
| Alameda | 8 |
| Dublin | 5 |
| Hangzhou | 4 |
| Ashburn | 3 |
| Valencia | 3 |
| Beijing | 2 |
| Helsinki | 2 |
| Lazarea | 2 |
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