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RiuNet: Repositorio Institucional de la Universidad Politécnica de Valencia
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|---|---|
| Análisis hardware en lógica reconfigurable de algoritmos de procesado de la señal de fibrilación ventricular cardíaca: aplicación a la obtención del índice de regularidad morfológica | 180 |
Visitas al mes
| octubre 2023 | noviembre 2023 | diciembre 2023 | enero 2024 | febrero 2024 | marzo 2024 | abril 2024 | |
|---|---|---|---|---|---|---|---|
| Análisis hardware en lógica reconfigurable de algoritmos de procesado de la señal de fibrilación ventricular cardíaca: aplicación a la obtención del índice de regularidad morfológica | 2 | 0 | 4 | 7 | 1 | 1 | 0 |
Visitas al fichero
| Visualizaciones | |
|---|---|
| Memoria TFM-FPGA_v3.pdf | 1 |
Países con más visualizaciones
| Visualizaciones | |
|---|---|
| Estados Unidos | 60 |
| España | 42 |
| Francia | 21 |
| China | 20 |
| Alemania | 8 |
| Irlanda | 8 |
| Grecia | 3 |
| Suecia | 3 |
| Finlandia | 2 |
| México | 2 |
Ciudades con más visualizaciones
| Visualizaciones | |
|---|---|
| Valencia | 22 |
| Louisville | 9 |
| Grenoble | 8 |
| Sunnyvale | 7 |
| Alameda | 6 |
| Villeurbanne | 6 |
| Ashburn | 5 |
| Beijing | 5 |
| Dublin | 4 |
| Hangzhou | 4 |
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