Máquina Moore: Estilo de 1 proceso

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dc.contributor.author	Gadea Gironés, Rafael	es_ES
dc.date.accessioned	2011-12-15T10:18:57Z
dc.date.available	2011-12-15T10:18:57Z
dc.date.issued	2011-12-15
dc.identifier.uri	http://hdl.handle.net/10251/14000
dc.description.abstract	Descripción de máquinas de estados con VHDL. Tipo de máquina: Moore. Estilo de descripción: un proceso.	es_ES
dc.description.uri	http://labvirtual.webs.upv.es/FSM_Moore_1.htm	es_ES
dc.language	Español	es_ES
dc.publisher	Universitat Politècnica de València	es_ES
dc.rights	Reserva de todos los derechos	es_ES
dc.subject	Fsm	es_ES
dc.subject	Vhdl	es_ES
dc.subject.classification	TECNOLOGIA ELECTRONICA	es_ES
dc.title	Máquina Moore: Estilo de 1 proceso	es_ES
dc.type	Objeto de aprendizaje	es_ES
dc.lom.learningResourceType	Laboratorio virtual de simulación	es_ES
dc.lom.interactivityLevel	Muy bajo	es_ES
dc.lom.semanticDensity	Muy bajo	es_ES
dc.lom.intendedEndUserRole	Profesor	es_ES
dc.lom.context	Primer ciclo	es_ES
dc.lom.difficulty	Fácil	es_ES
dc.lom.typicalLearningTime	5 minutos	es_ES
dc.lom.educationalLanguage	Español	es_ES
dc.upv.convocatoriaDocenciaRed	2011-1	es_ES
dc.upv.ambito	PUBLICO	es_ES
dc.rights.accessRights	Abierto	es_ES
dc.contributor.affiliation	Universitat Politècnica de València. Escuela Técnica Superior de Ingenieros de Telecomunicación - Escola Tècnica Superior d'Enginyers de Telecomunicació	es_ES
dc.description.bibliographicCitation	Gadea Gironés, R. (2011). Máquina Moore: Estilo de 1 proceso. http://hdl.handle.net/10251/14000	es_ES