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Simulación HDL de NIOS2

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Simulación HDL de NIOS2

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dc.contributor.author Gadea Gironés, Rafael es_ES
dc.date.accessioned 2020-05-19T09:31:50Z
dc.date.available 2020-05-19T09:31:50Z
dc.date.issued 2020-05-19T09:31:50Z
dc.identifier.uri http://hdl.handle.net/10251/143687
dc.description.abstract Realización mediante simulador HDL de una verificación de un sistema Hardware-software es_ES
dc.description.uri https://polimedia.upv.es/visor/?id=382a92c0-8afb-11ea-8842-9f9926e21c94 es_ES
dc.language Español es_ES
dc.publisher Universitat Politècnica de València es_ES
dc.rights Reconocimiento (by) es_ES
dc.subject Simulación es_ES
dc.subject HDL es_ES
dc.subject Codiseño es_ES
dc.subject.classification TECNOLOGIA ELECTRONICA es_ES
dc.title Simulación HDL de NIOS2 es_ES
dc.type Objeto de aprendizaje es_ES
dc.lom.learningResourceType Screencast es_ES
dc.lom.interactivityLevel Bajo es_ES
dc.lom.semanticDensity Bajo es_ES
dc.lom.intendedEndUserRole Alumno es_ES
dc.lom.context Ciclo superior es_ES
dc.lom.difficulty Fácil es_ES
dc.lom.typicalLearningTime 10 minutos es_ES
dc.lom.educationalDescription Simple visualización es_ES
dc.lom.educationalLanguage Español es_ES
dc.upv.convocatoriaDocenciaRed 2019-2020 es_ES
dc.upv.ambito PUBLICO es_ES
dc.subject.unesco 3307 - Tecnología electrónica es_ES
dc.rights.accessRights Abierto es_ES
dc.contributor.affiliation Universitat Politècnica de València. Escuela Técnica Superior de Ingenieros de Telecomunicación - Escola Tècnica Superior d'Enginyers de Telecomunicació es_ES
dc.contributor.affiliation Universitat Politècnica de València. Departamento de Ingeniería Electrónica - Departament d'Enginyeria Electrònica es_ES
dc.description.bibliographicCitation Gadea Gironés, R. (2020). Simulación HDL de NIOS2. http://hdl.handle.net/10251/143687 es_ES
dc.description.accrualMethod DER es_ES
dc.relation.pasarela DER\29061 es_ES


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