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Diseño de funciones con HDL: verificación

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Diseño de funciones con HDL: verificación

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Gadea Gironés, R. (2023). Diseño de funciones con HDL: verificación. http://hdl.handle.net/10251/193904

Por favor, use este identificador para citar o enlazar este ítem: http://hdl.handle.net/10251/193904

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Metadatos del ítem

Título: Diseño de funciones con HDL: verificación
Autor: Gadea Gironés, Rafael
Entidad UPV: Universitat Politècnica de València. Escuela Técnica Superior de Ingenieros de Telecomunicación - Escola Tècnica Superior d'Enginyers de Telecomunicació
Universitat Politècnica de València. Departamento de Ingeniería Electrónica - Departament d'Enginyeria Electrònica
Fecha difusión:
Resumen:
Diseño de funciones con HDL: verificación
Palabras clave: Verificación , HDL , Punto flotante
Código UNESCO: 3306 - Ingeniería y tecnología eléctrica
Derechos de uso: Reconocimiento (by)
Tipo: Objeto de aprendizaje
URL: https://polimedia.upv.es/visor/?id=991e3460-d909-11ed-b716-77ee466eb043
Tipo de recurso educativo: Screencast
Descripción acerca del uso: Visualizar vídeo
Destinatario: Alumno
Contexto: Ciclo superior
Dificultad: Dificultad media
Nivel de interactividad: Bajo
Densidad semántica: Bajo
Tiempo típico: 10 minutos
Idioma del destinatario: Español
Permiso de acceso: PUBLICO

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