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Editor para HDL: Visor de esquemático

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Editor para HDL: Visor de esquemático

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dc.contributor.author Gadea Gironés, Rafael es_ES
dc.date.accessioned 2024-06-09T12:17:59Z
dc.date.available 2024-06-09T12:17:59Z
dc.date.issued 2024-06-09T12:17:59Z
dc.identifier.uri http://hdl.handle.net/10251/204846
dc.description.abstract Configuración de vscode para poder ver el hardware descrito en HDL es_ES
dc.description.uri https://polimedia.upv.es/visor/?id=a5f3dda0-ccdf-11ee-af83-239545787e20 es_ES
dc.language Español es_ES
dc.rights Reconocimiento (by) es_ES
dc.subject Visual Studio Code es_ES
dc.subject Schematic Viewer es_ES
dc.subject HDL es_ES
dc.subject Visor de esquemáticos es_ES
dc.title Editor para HDL: Visor de esquemático es_ES
dc.type Objeto de aprendizaje es_ES
dc.lom.learningResourceType Screencast es_ES
dc.lom.interactivityLevel Bajo es_ES
dc.lom.semanticDensity Bajo es_ES
dc.lom.intendedEndUserRole Alumno es_ES
dc.lom.context Primer ciclo es_ES
dc.lom.difficulty Fácil es_ES
dc.lom.typicalLearningTime 10 minutos es_ES
dc.lom.educationalDescription Simple visualización es_ES
dc.lom.educationalLanguage Español es_ES
dc.upv.convocatoriaDocenciaRed 2023-2024 es_ES
dc.upv.ambito PUBLICO es_ES
dc.subject.unesco 3307 - Tecnología electrónica es_ES
dc.rights.accessRights Abierto es_ES
dc.contributor.affiliation Universitat Politècnica de València. Escuela Técnica Superior de Ingenieros de Telecomunicación - Escola Tècnica Superior d'Enginyers de Telecomunicació es_ES
dc.contributor.affiliation Universitat Politècnica de València. Departamento de Ingeniería Electrónica - Departament d'Enginyeria Electrònica es_ES
dc.description.bibliographicCitation Gadea Gironés, R. (2024). Editor para HDL: Visor de esquemático. http://hdl.handle.net/10251/204846 es_ES
dc.description.accrualMethod DER es_ES
dc.relation.pasarela DER\37619 es_ES


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