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High-performance architectures for high-radix switches

RiuNet: Repositorio Institucional de la Universidad Politécnica de Valencia

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High-performance architectures for high-radix switches

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dc.contributor.advisor Flich Cardo, José es_ES
dc.contributor.advisor Duato Marín, José Francisco es_ES
dc.contributor.author Mora Porta, Gaspar es_ES
dc.date.accessioned 2009-04-02T10:22:31Z
dc.date.available 2009-04-02T10:22:31Z
dc.date.created 2009-01-16T09:00:00Z es_ES
dc.date.issued 2009-04-02T10:22:21Z es_ES
dc.identifier.uri http://hdl.handle.net/10251/4335
dc.description.abstract Para beneficiarse de una reducción en la latencia así como disminuir tanto el consumo como el coste, el número óptimo de puertos de un conmutador ha ido aumentando a lo largo del tiempo. Sin embargo, las arquitecturas tradicionales se han quedado atrás bien por bajo rendimiento o bien por problemas de escalabilidad con el número de puertos. En esta Tesis se propone una nueva arquitectura de conmutador válida para conmutadores de elevado grado llamada Partitioned Crossbar Input Queued (PCIQ). Esta arquitectura resuelve el problema de los excesivos requerimientos de memoria en el diseño de arquitecturas de elevado grado. Además PCIQ define una nueva familia de arquitecturas de conmutador. PCIQ se basa en un particionado inteligente del crossbar, dividiéndolo en sub-crossbars, requiriendo menos recursos de memoria que las otras propuestas para conmutadores de elevado grado y que consigue una mayor eficiencia debido en parte a un incremento en la eficiencia de los árbitros empleados en el diseño. En este sentido, PCIQ emplea dos árbitros con prioridad rotativa (uno para cada sub-crossbar) que presentan un coste lineal y una respuesta en el tiempo logarítmica conforme aumenta el número de puertos del conmutador. Además PCIQ tiene un coste (medido en términos de requerimientos de memoria, complejidad del crossbar y complejidad en el arbitraje) similar o incluso menor que organizaciones básicas como CIOQ. No obstante PCIQ es capaz de conseguir máxima eficiencia para distribuciones de tráfico uniforme. El bloqueo por paquete al principio de cola (o HOL en inglés) reduce dramáticamente el rendimiento del conmutador. Las soluciones tradicionales para eliminar el bloqueo por HOL no son escalables con el número de puertos o requieren arquitecturas complejas. En esta Tesis se propone una técnica de control de la congestión que elimina el bloqueo por HOL llamada RECN-IQ. RECN-IQ está diseñada para conmutadores con memorias sólo a la entrada y es una técnica altamente eficiente es_ES
dc.language Inglés es_ES
dc.publisher Universitat Politècnica de València es_ES
dc.rights Reserva de todos los derechos es_ES
dc.source Riunet
dc.subject High-radix es_ES
dc.subject Switch es_ES
dc.subject Conmutador de grado elevado es_ES
dc.subject Control de la congestion es_ES
dc.subject Congestion management es_ES
dc.subject.classification ARQUITECTURA Y TECNOLOGIA DE COMPUTADORES es_ES
dc.title High-performance architectures for high-radix switches
dc.type Tesis doctoral es_ES
dc.subject.unesco 3304 - Tecnología de los ordenadores es_ES
dc.subject.unesco 330406 - Arquitectura de ordenadores es_ES
dc.subject.unesco 330413 - Dispositivos de transmisión de datos es_ES
dc.identifier.doi 10.4995/Thesis/10251/4335 es_ES
dc.rights.accessRights Abierto es_ES
dc.contributor.affiliation Universitat Politècnica de València. Departamento de Informática de Sistemas y Computadores - Departament d'Informàtica de Sistemes i Computadors es_ES
dc.description.bibliographicCitation Mora Porta, G. (2009). High-performance architectures for high-radix switches [Tesis doctoral]. Universitat Politècnica de València. https://doi.org/10.4995/Thesis/10251/4335 es_ES
dc.description.accrualMethod Palancia es_ES
dc.type.version info:eu-repo/semantics/acceptedVersion es_ES
dc.relation.tesis 2970 es_ES


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