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Design and implementation of decoders for error correction in high-speed communication systems

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Design and implementation of decoders for error correction in high-speed communication systems

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Català Pérez, JM. (2017). Design and implementation of decoders for error correction in high-speed communication systems [Tesis doctoral]. Universitat Politècnica de València. https://doi.org/10.4995/Thesis/10251/86152

Por favor, use este identificador para citar o enlazar este ítem: http://hdl.handle.net/10251/86152

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Metadatos del ítem

Título: Design and implementation of decoders for error correction in high-speed communication systems
Autor: Català Pérez, Joan Marc
Director(es): García Herrero, Francisco Miguel Valls Coquillat, Javier
Entidad UPV: Universitat Politècnica de València. Departamento de Ingeniería Electrónica - Departament d'Enginyeria Electrònica
Fecha acto/lectura:
2017-07-07
Fecha difusión:
Resumen:
This thesis is focused on the design and implementation of binary low-density parity-check (LDPC) code decoders for high-speed modern communication systems. The basic of LDPC codes and the performance and bottlenecks, in ...[+]


Esta tesis se ha centrado en el diseño e implementación de decodificadores binarios basados en códigos de comprobación de paridad de baja densidad (LDPC) válidos para los sistemas de comunicación modernos de alta velocidad. ...[+]


Aquesta tesi s'ha centrat en el disseny i implementació de descodificadors binaris basats en codis de comprovació de paritat de baixa densitat (LDPC) vàlids per als sistemes de comunicació moderns d'alta velocitat. Els ...[+]
Palabras clave: LDPC , decoding , OMO-MSA , MO2-BIT-MSA , HE-RBID , ECC , decoders , FPGA
Derechos de uso: Reserva de todos los derechos
DOI: 10.4995/Thesis/10251/86152
Editorial:
Universitat Politècnica de València
Tipo: Tesis doctoral

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