Módulo Hardware de Compresión en Tiempo Real

dc.contributor.advisorHerrero Bosch, Vicente
dc.contributor.advisorEsteve Bosch, Raul
dc.contributor.affiliationDepartamento de Ingeniería Electrónica
dc.contributor.affiliationEscuela Técnica Superior de Ingeniería de Telecomunicación
dc.contributor.affiliationEscuela Técnica Superior de Ingeniería Industrial
dc.contributor.affiliationInstituto de Instrumentación para Imagen Molecular
dc.contributor.authorRodríguez Ponce, Jorgees_ES
dc.date.accessioned2019-10-09T07:00:46Z
dc.date.available2019-10-09T07:00:46Z
dc.date.created2019-09-19es_ES
dc.date.issued2019-10-09es_ES
dc.description.abstract[ES] En el desarrollo del proyecto se buscará una correcta realización e implementación de un módulo digital de compresión de datos. Dicho módulo incluirá un algoritmo de compresión considerado óptimo y tendrá como finalidad ser implementado para reducir el flujo de datos generados en la lectura de un experimento llevado a cabo con PMTs y su distribución en tiempo real con un enlace de GbE. Las partes distinguibles dentro del proyecto serán: -Decisión del algoritmo de compresión a implementar. -Esquema de compresión. -Descripción Verilog del diseño en ISE. -Comprobación de la implementación y correcciones -Optimizaciónes_ES
dc.description.abstract[EN] In the development of the project a correct realization and implementation of a digital module of data compression will looked for. This module will include a compression algorithm considered optimal and its purpose will be to be implemented to reduce the flow of data generated in the reading of an experiment carried out with PMTs and its distribution in real time with a GbE link. The distinguishable parts within the project will be: -Decision of the compression algorithm to be implemented. -Compression scheme. -Verilog description of the design in ISE. -Verification of the implementation and corrections. -Optimizationen_EN
dc.description.accrualMethodTFGMes_ES
dc.description.bibliographicCitationRodríguez Ponce, J. (2019). Módulo Hardware de Compresión en Tiempo Real. https://riunet.upv.es/handle/10251/127837es_ES
dc.identifier.urihttps://riunet.upv.es/handle/10251/127837
dc.languageEspañoles_ES
dc.publisherUniversitat Politècnica de Valènciaes_ES
dc.relation.pasarelaTFGM\109411es_ES
dc.rightsReconocimiento - No comercial - Sin obra derivada (by-nc-nd)es_ES
dc.rights.accessRightsAbiertoes_ES
dc.subjectCompresión datoses_ES
dc.subjectVeriloges_ES
dc.subjectFPGAes_ES
dc.subjectData compressionen_EN
dc.subject.classificationTECNOLOGIA ELECTRONICAes_ES
dc.subject.otherGrado en Ingeniería de Tecnologías y Servicios de Telecomunicación-Grau en Enginyeria de Tecnologies i Serveis de Telecomunicacióes_ES
dc.titleMódulo Hardware de Compresión en Tiempo Reales_ES
dc.typeProyecto/Trabajo fin de carrera/gradoes_ES
dspace.entity.typePublication
person.identifier19171
person.identifier26376
person.identifier.orcid0000-0003-0860-2789
person.identifier.orcid0000-0002-1289-6938
relation.isAdvisorOfPublicationf7733678-ef4b-4ff0-86e4-a887c7df6537
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relation.isOrgUnitOfPublicationa3ca7df3-e467-4f69-b673-79a5d6241220
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relation.isOrgUnitOfPublication.latestForDiscoverya3ca7df3-e467-4f69-b673-79a5d6241220
upv.uuid8700cce9-c5c6-472d-bbca-e774665eaee3es_ES

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