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Diseño de Funciones con HDL: Tablas VHDL

RiuNet: Repositorio Institucional de la Universidad Politécnica de Valencia

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Diseño de Funciones con HDL: Tablas VHDL

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Gadea Gironés, R. (2023). Diseño de Funciones con HDL: Tablas VHDL. http://hdl.handle.net/10251/193889

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Metadatos del ítem

Título: Diseño de Funciones con HDL: Tablas VHDL
Autor: Gadea Gironés, Rafael
Entidad UPV: Universitat Politècnica de València. Escuela Técnica Superior de Ingenieros de Telecomunicación - Escola Tècnica Superior d'Enginyers de Telecomunicació
Universitat Politècnica de València. Departamento de Ingeniería Electrónica - Departament d'Enginyeria Electrònica
Fecha difusión:
Resumen:
Realización mediante de funciones en VHDL mediante tablas
Palabras clave: Diseño de funciones , High Level Synthesis (HLS) , VHDL , Verilog , Read-only memory (ROM)
Código UNESCO: 3306 - Ingeniería y tecnología eléctrica
Derechos de uso: Reconocimiento (by)
Tipo: Objeto de aprendizaje
URL: https://polimedia.upv.es/visor/?id=0d9ee1d0-d86b-11ed-98a2-2181e0407ace
Tipo de recurso educativo: Screencast
Descripción acerca del uso: visualizar el vídeo
Destinatario: Alumno
Contexto: Ciclo superior
Dificultad: Dificultad media
Nivel de interactividad: Bajo
Densidad semántica: Bajo
Tiempo típico: 10 minutos
Idioma del destinatario: Español
Permiso de acceso: PUBLICO

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