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Impact on performance and energy of the retention time and processor frequency in L1 macrocell-based data caches

RiuNet: Repositorio Institucional de la Universidad Politécnica de Valencia

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Impact on performance and energy of the retention time and processor frequency in L1 macrocell-based data caches

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Valero Bresó, A.; Sahuquillo Borrás, J.; Lorente Garcés, VJ.; Petit Martí, SV.; López Rodríguez, PJ.; Duato Marín, JF. (2012). Impact on performance and energy of the retention time and processor frequency in L1 macrocell-based data caches. IEEE Transactions on Very Large Scale Integration (VLSI) Systems. 20(6):1108-1117. doi:10.1109/TVLSI.2011.2142202.

Por favor, use este identificador para citar o enlazar este ítem: http://hdl.handle.net/10251/34853

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Título: Impact on performance and energy of the retention time and processor frequency in L1 macrocell-based data caches
Autor:
Entidad UPV: Universitat Politècnica de València. Departamento de Informática de Sistemas y Computadores - Departament d'Informàtica de Sistemes i Computadors
Fecha difusión:
Resumen:
Cache memories dissipate an important amount of the energy budget in current microprocessors. This is mainly due to cache cells are typically implemented with six transistors. To tackle this design concern, recent research ...[+]
Palabras clave: Edram memory cells , Edram capacitance , Energy consumption , Retention time , Sram memory cells
Derechos de uso: Reserva de todos los derechos
Fuente:
IEEE Transactions on Very Large Scale Integration (VLSI) Systems. (issn: 1063-8210 )
DOI: 10.1109/TVLSI.2011.2142202
Editorial:
Institute of Electrical and Electronics Engineers (IEEE)
Versión del editor: http://dx.doi.org/10.1109/TVLSI.2011.2142202
Patrocinador:
Spanish CICYT [TIN2009-14475-C04-01]
Consolider-Ingenio [CSD2006-00046]
European community [289154]
Tipo: Artículo

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