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RiuNet: Repositorio Institucional de la Universidad Politécnica de Valencia
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| Visualizaciones | |
|---|---|
| Desarrollo de un generador de patrones y analizador lógico basado en FPGA | 219 |
Visitas al mes
| marzo 2024 | abril 2024 | mayo 2024 | junio 2024 | julio 2024 | agosto 2024 | septiembre 2024 | |
|---|---|---|---|---|---|---|---|
| Desarrollo de un generador de patrones y analizador lógico basado en FPGA | 4 | 1 | 11 | 6 | 4 | 4 | 2 |
Visitas al fichero
| Visualizaciones | |
|---|---|
| Compadre - Desarrollo de un generador de patrones y analizador lógico basado en FPGA.pdf | 1414 |
Países con más visualizaciones
| Visualizaciones | |
|---|---|
| Estados Unidos | 56 |
| España | 46 |
| Irlanda | 13 |
| Chile | 11 |
| México | 11 |
| China | 9 |
| Polonia | 8 |
| Eslovenia | 8 |
| Francia | 7 |
| Colombia | 6 |
Ciudades con más visualizaciones
| Visualizaciones | |
|---|---|
| Valencia | 9 |
| Poznan | 8 |
| Vodice | 8 |
| Dublin | 7 |
| Santiago | 7 |
| Alameda | 6 |
| Grenoble | 6 |
| Southport | 6 |
| Louisville | 5 |
| Ashburn | 4 |
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