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Entorno de evaluación de redes en el chip para sistemas CMP

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Entorno de evaluación de redes en el chip para sistemas CMP

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Camacho Villanueva, J. (2009). Entorno de evaluación de redes en el chip para sistemas CMP. http://hdl.handle.net/10251/14525

Por favor, use este identificador para citar o enlazar este ítem: http://hdl.handle.net/10251/14525

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[Cerrado]
Nombre: Tesis de Máster-Jesús ...
Tamaño: 1.239Mb
Formato: PDF
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Metadatos del ítem

Título: Entorno de evaluación de redes en el chip para sistemas CMP
Autor: Camacho Villanueva, Jesús
Director(es): Flich Cardo, José
Entidad UPV: Universitat Politècnica de València. Servicio de Alumnado - Servei d'Alumnat
Fecha acto/lectura:
2009-12
 Fecha difusión:
Resumen:
Se desarrolla una herramienta de simulación de redes en el chip para CMPs y se realizan análisis de topologías.
Palabras clave: Redes en el chip , Multiprocesadores en el chip , Modelos de simulación
Derechos de uso: Cerrado
Editorial:
Universitat Politècnica de València
Titulación: Máster Universitario en Ingeniería de Computadores-Màster Universitari en Enginyeria de Computadors
Tipo: Tesis de máster

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