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Diseño de un banco de pruebas para automatizar la verificación de microprocesadores RISC-V descritos en HDL mediante uso de metodología UVM.

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Diseño de un banco de pruebas para automatizar la verificación de microprocesadores RISC-V descritos en HDL mediante uso de metodología UVM.

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Barrera Comeche, V. (2022). Diseño de un banco de pruebas para automatizar la verificación de microprocesadores RISC-V descritos en HDL mediante uso de metodología UVM. Universitat Politècnica de València. http://hdl.handle.net/10251/187877

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Title: Diseño de un banco de pruebas para automatizar la verificación de microprocesadores RISC-V descritos en HDL mediante uso de metodología UVM.
Secondary Title: Testbench design for HDL described RISC-V microprocessors automated verification using UVM methodology.
Disseny d un banc de proves per a automatitzar la verificació de microprocessadors RISC-V descrits en HDL mitjançant l ús de metodologia UVM
Author: Barrera Comeche, Vicente
Director(s): Monzó Ferrer, José María Gadea Gironés, Rafael
UPV Unit: Universitat Politècnica de València. Departamento de Ingeniería Electrónica - Departament d'Enginyeria Electrònica
Universitat Politècnica de València. Escuela Técnica Superior de Ingenieros de Telecomunicación - Escola Tècnica Superior d'Enginyers de Telecomunicació
Read date / Event date:
2022-09-12
Issued date:
Abstract:
[ES] El presente TFG busca desarrollar un banco de pruebas mediante la metodología UVM que permita automatizar la verificación de un microprocesador RISC-V descrito en HDL que cumpla un juego de instrucciones determinado. RISCV ...[+]
Subjects: Verificación , UVM , RISC-V
Copyrigths: Reserva de todos los derechos
Publisher:
Universitat Politècnica de València
degree: Grado en Ingeniería de Tecnologías y Servicios de Telecomunicación-Grau en Enginyeria de Tecnologies i Serveis de Telecomunicació
Type: Proyecto/Trabajo fin de carrera/grado

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