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Análisis hardware en lógica reconfigurable de algoritmos de procesado de la señal de fibrilación ventricular cardíaca: aplicación a la obtención del índice de regularidad morfológica.

RiuNet: Repositorio Institucional de la Universidad Politécnica de Valencia

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Análisis hardware en lógica reconfigurable de algoritmos de procesado de la señal de fibrilación ventricular cardíaca: aplicación a la obtención del índice de regularidad morfológica.

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Osorno Caudet, D. (2013). Análisis hardware en lógica reconfigurable de algoritmos de procesado de la señal de fibrilación ventricular cardíaca: aplicación a la obtención del índice de regularidad morfológica. http://hdl.handle.net/10251/37147.

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Metadatos del ítem

Título: Análisis hardware en lógica reconfigurable de algoritmos de procesado de la señal de fibrilación ventricular cardíaca: aplicación a la obtención del índice de regularidad morfológica.
Autor:
Director(es): Guerrero Martínez, Juan Bataller Mompeán, Manuel
Entidad UPV: Universitat Politècnica de València. Servicio de Alumnado - Servei d'Alumnat
Fecha difusión:
Fecha acto/lectura: 2013-09-26
Resumen:
[ES] Análisis de la implementación hardware, mediante lógica reconfigurable, de un algoritmo de procesado de la señal de fibrilación ventricular cardíaca para la obtención del índice de regularidad, que cuantifica el grado ...[+]


[EN] Hardware implementation analysis, by means of logic arrays, of a processing algorithm of cardiac ventricular fibrilation signal to obtain the regularity index, which quantify the degree of regularity morphological, ...[+]
Palabras clave: FPGA , Índice de regularidad , Fibrilación , Regularity index , Fibrillation
Derechos de uso: Cerrado
Titulación: Máster Universitario en Ingeniería Biomédica-Màster Universitari en Enginyeria Biomèdica
Tipo: Tesis de máster

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