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Diseño e implementación en FPGA de un decodificador Reed-Solomon de alta velocidad

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Diseño e implementación en FPGA de un decodificador Reed-Solomon de alta velocidad

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García Herrero, FM. (2008). Diseño e implementación en FPGA de un decodificador Reed-Solomon de alta velocidad. Universitat Politècnica de València. http://hdl.handle.net/10251/58941

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Tamaño: 1.842Mb
Formato: PDF
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Metadatos del ítem

Título: Diseño e implementación en FPGA de un decodificador Reed-Solomon de alta velocidad
Autor: García Herrero, Francisco Miguel
Director(es): Canet Subiela, Mª José Almenar Terré, Vicenç Valls Coquillat, Javier
Entidad UPV: Universitat Politècnica de València. Instituto Universitario de Telecomunicación y Aplicaciones Multimedia - Institut Universitari de Telecomunicacions i Aplicacions Multimèdia
Universitat Politècnica de València. Departamento de Ingeniería Electrónica - Departament d'Enginyeria Electrònica
Universitat Politècnica de València. Departamento de Comunicaciones - Departament de Comunicacions
Universitat Politècnica de València. Escuela Politécnica Superior de Gandia - Escola Politècnica Superior de Gandia
Fecha acto/lectura:
2008-07-15
 Fecha difusión:
Resumen:
La finalidad principal del proyecto es el diseño e implementación de un decodificador Reed-Solomon de alta velocidad, no obstante existen una serie de objetivos intermedios que es necesario cumplir, para alcazar esta ...[+]
Derechos de uso: Cerrado
Editorial:
Universitat Politècnica de València
Titulación: Ingeniero Técnico de Telecomunicación, esp. en Sistemas de Telecomunicación-Enginyer Tècnic de Telecomunicació, esp. en Sistemes de Telecomunicacions
Tipo: Proyecto/Trabajo fin de carrera/grado

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