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Sistemas secuenciales síncronos: síntesis desde codificación mínima

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Sistemas secuenciales síncronos: síntesis desde codificación mínima

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Martí Campoy, A. (2016). Sistemas secuenciales síncronos: síntesis desde codificación mínima. http://hdl.handle.net/10251/68317

Por favor, use este identificador para citar o enlazar este ítem: http://hdl.handle.net/10251/68317

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Metadatos del ítem

Título: Sistemas secuenciales síncronos: síntesis desde codificación mínima
Autor: Martí Campoy, Antonio
Entidad UPV: Universitat Politècnica de València. Escola Tècnica Superior d'Enginyeria Informàtica
Universitat Politècnica de València. Departamento de Informática de Sistemas y Computadores - Departament d'Informàtica de Sistemes i Computadors
Fecha difusión:
Resumen:
Este artículo docente presenta el proceso de síntesis de un Sistema Secuencial Síncrono mediante un ejemplo. Se parte de una tabla de estados codidicados con codificación mínima para un automáta de Moore.
Palabras clave: Circuito , Secuencial , Síncrono , Digital , Autómata , Síntesis , Codificación mínima , Informática.
Código UNESCO: 3304 - Tecnología de los ordenadores (microelectrónica)
Derechos de uso: Reconocimiento - No comercial - Sin obra derivada (by-nc-nd)
Editorial:
Universitat Politècnica de València
Tipo: Objeto de aprendizaje
Tipo de recurso educativo: Artículo Docente
Descripción acerca del uso: Necesitas papel y lápiz o su equivalente digital para reproducir los ejemplos.
Destinatario: Alumno
Contexto: Primer ciclo
Dificultad: Dificultad media
Nivel de interactividad: Bajo
Densidad semántica: Alto
Tiempo típico: 20 minutos
Idioma del destinatario: Español
Permiso de acceso: PUBLICO

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