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dc.contributor.advisor | Valls Coquillat, Javier | es_ES |
dc.contributor.advisor | Ramos Peinado, Germán | es_ES |
dc.contributor.author | Rodríguez Vercher, Juan Carlos | es_ES |
dc.date.accessioned | 2019-03-06T12:15:27Z | |
dc.date.available | 2019-03-06T12:15:27Z | |
dc.date.created | 2019-02-28 | |
dc.date.issued | 2019-03-06 | es_ES |
dc.identifier.uri | http://hdl.handle.net/10251/117726 | |
dc.description.abstract | [ES] En el presente trabajo se aborda el diseño y prototipado de un sintetizador digital de audio sobre una arquitectura System on Chip (SoC). El diseño se plantea sobre la herramienta Simulink® y, mediante plug-ins para generación automática de código, se convierte el modelo visual del sistema en código C, desplegable en el procesador software, y en código VHDL, sintetizable para su despliegue en el chip FPGA, ambos integrados en el SoC de la placa de desarrollo utilizada. En primer lugar, se aborda el diseño de las etapas de la cadena de síntesis, valorando diferentes opciones de diseño en cada una de ellas, con el fin de obtener las características sonoras deseadas. Tras validar el diseño inicial, se plantea su separación dos bloques de procesado software y hardware, para posteriormente realizar la conversión a precisión finita del bloque hardware. Tras la comprobar que el nuevo modelo mantiene las prestaciones del modelo original, se genera automáticamente el código y se despliega en el SoC de la placa de desarrollo, donde se realiza la validación final del sistema. El resultado final es un sintetizador digital de audio implementado en un SoC, aprovechando las ventajas del procesado software y de la lógica programable. | es_ES |
dc.description.abstract | [EN] The present work approaches the design and prototyping of a digital audio synthesizer based on a System on Chip (SoC) architecture. The design is leveraged on the Simulink® tool and, by means of plug-ins for the automatic code generation, the system visual model turns into C code, deployable on the software processor, and into synthesizable VHDL code, for its deployment in the FPGA chip, both integrated in the SoC of the development board. First, the design of the stages of the synthesis chain is carried out, evaluating different design options for each one of them, in order to achieve the desired sound characteristics. After validating the initial design, the system is partitioned into 2 blocks: a processing software block and hardware logic block, for later carrying out the conversion to finite precision of the hardware block. After checking that the new model maintains the features of the original model, the code is automatically generated and deployed in the SoC of the development board where the final validation of the system is carried out. The final result of the work is in a digital audio synthesizer implemented in a SoC, taking advantage of the processed software and the programmable logic. | es_ES |
dc.format.extent | 52 | es_ES |
dc.language | Español | es_ES |
dc.publisher | Universitat Politècnica de València | es_ES |
dc.rights | Reconocimiento (by) | es_ES |
dc.subject | Síntesis digital | es_ES |
dc.subject | Procesado de digital de audio | es_ES |
dc.subject | System on Chip (SoC) | es_ES |
dc.subject | ARM | es_ES |
dc.subject | FPGA | es_ES |
dc.subject | HDL | es_ES |
dc.subject | Simulink | es_ES |
dc.subject | Digital synthesis | es_ES |
dc.subject | Digital Audio Processing | es_ES |
dc.subject.classification | TECNOLOGIA ELECTRONICA | es_ES |
dc.subject.other | Grado en Ingeniería de Sistemas de Telecomunicación, Sonido e Imagen-Grau en Enginyeria de Sistemes de Telecomunicació, So i Imatge | es_ES |
dc.title | Diseño y prototipado de un sintetizador digital basado en una arquitectura system on chip (SoC) | es_ES |
dc.type | Proyecto/Trabajo fin de carrera/grado | es_ES |
dc.rights.accessRights | Abierto | es_ES |
dc.contributor.affiliation | Universitat Politècnica de València. Instituto Universitario de Telecomunicación y Aplicaciones Multimedia - Institut Universitari de Telecomunicacions i Aplicacions Multimèdia | es_ES |
dc.contributor.affiliation | Universitat Politècnica de València. Escuela Técnica Superior de Ingenieros de Telecomunicación - Escola Tècnica Superior d'Enginyers de Telecomunicació | es_ES |
dc.contributor.affiliation | Universitat Politècnica de València. Departamento de Ingeniería Electrónica - Departament d'Enginyeria Electrònica | es_ES |
dc.contributor.affiliation | Universitat Politècnica de València. Escuela Politécnica Superior de Gandia - Escola Politècnica Superior de Gandia | es_ES |
dc.description.bibliographicCitation | Rodríguez Vercher, JC. (2019). Diseño y prototipado de un sintetizador digital basado en una arquitectura system on chip (SoC). Universitat Politècnica de València. http://hdl.handle.net/10251/117726 | es_ES |
dc.description.accrualMethod | TFGM | es_ES |
dc.relation.pasarela | TFGM\90950 | es_ES |