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Diseño de un core para implementar filtros FIR con arquitectura paralela en dispositivos FPGA

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Diseño de un core para implementar filtros FIR con arquitectura paralela en dispositivos FPGA

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Català Pérez, JM. (2008). Diseño de un core para implementar filtros FIR con arquitectura paralela en dispositivos FPGA. Universitat Politècnica de València. http://hdl.handle.net/10251/53164

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Metadatos del ítem

Título: Diseño de un core para implementar filtros FIR con arquitectura paralela en dispositivos FPGA
Autor: Català Pérez, Joan Marc
Director(es): Valls Coquillat, Javier
Entidad UPV: Universitat Politècnica de València. Instituto Universitario de Telecomunicación y Aplicaciones Multimedia - Institut Universitari de Telecomunicacions i Aplicacions Multimèdia
Universitat Politècnica de València. Departamento de Ingeniería Electrónica - Departament d'Enginyeria Electrònica
Universitat Politècnica de València. Escuela Politécnica Superior de Gandia - Escola Politècnica Superior de Gandia
Fecha acto/lectura:
2008-04-04
 Fecha difusión:
Resumen:
El objetivo principal del presente proyecto es el diseño e implementación en FPGA de filtros FIR de tasa simple y multitasa (interpoladores y diezmadores) basándose en el uso de los hardcores multiplicadores empotrados ...[+]
Derechos de uso: Cerrado
Editorial:
Universitat Politècnica de València
Titulación: Ingeniero Técnico de Telecomunicación, esp. en Sistemas Electrónicos-Enginyer Tècnic en Telecomunicació, esp. en Sistemes Electrònics
Tipo: Proyecto/Trabajo fin de carrera/grado

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